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EDA教学计划与考核标准
32学时的实验安排（电信与通信工程专业）
32学时共1.5个学分，２０学时的理论学习，12学时的实验，实验一：一位全加器（４学时）实验二：ＬＥＤ译码器（２学时）实验三：４位计数器（２学时）
实验四：自由设计综合逻辑电路实验（２学时）ＥＤＡ测试
（２学时）
考核标准：
实验课程考核为等到级考核，分为优 良 中 及格 不及格五个等次。
及格要求：能熟练地完成实验一、二、三中的任何一个实验
中等要求：在及格的基础上完成一个复杂的组合与时序逻辑电路的设计（如数字钟等）
良好要求：在中等到基础上，会下列内容之一
1：会使用FPGA芯片内的RAM资源
2：熟悉掌握Quartus II 9.0 的逻辑分析仪
3：其它一种功能
优秀要求：在中等基础上会良好要求的三种以上，或其它自己独立掌握的DE2-70板载资源功能任意三种以上。
2：熟悉掌握Quartus II 9.0 的逻辑分析仪
3：其它一种ED2-70板载的资源功能。
优秀要求：在中等基础上会良好要求的三种以上，其它自己独立掌握DE2-70板载资源功能四种以上。
实验一：一位全加器实验（４学时）
实验内容：有原理图输入法完成一个一位全加器的实验 实验设备：
硬件：计算机，Altera DE2-70板
软件：Quartus II 9.0(32-Bit)实验要求：
１：预习ＥＤＡ设计流程
２：预习一位全加器组合逻辑电路 ３：掌握Quartus II 原理图输入方法 ４：建立工程与原理图设计文档 ５：得出仿真波形
６：设置目标器件与引脚绑定方法
７： 配置与下载，并用实验板测试实验电路． ８：完成实验报告。
具体流程见教材
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