实验4 计数器加译码器设计和基于LPM宏模块的计数器设计_实验四计数器的设计

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实验报告

实验名称：

实用数字电子设计基础

计数器加译码器设计和基于LPM宏模块的计数器设计 实验目的：初步掌握Quartus II基于LPM宏模块的设计流程与方法并由此引出基于LPM模块的许多其他实用数字系统的自动设计技术。实验内容：

根据教材175页8.5节的流程，利用Quartus II完成基于LPM宏模块的计数器设计编辑和仿真测试等步骤，给出仿真波形。

在实验系统上硬件测试，验证此设计的功能并进行解说。对于引脚锁定以及硬件下载测试。

计数器加译码器设计

（1）程序输入： dec17s程序：

module dec17s(a,led7s);

input [3:0] a;

output [6:0] led7s;

reg [6:0] led7s;

always @(a)case(a)4'b0000: led7s

module count(en,clk,clr,cout,outy);input en,clk,clr;output [3:0]outy;output cout;reg [3:0]outy;always @(posedge clk or posedge clr)begin

if(clr)outy

else if(en)

begin if(outy==4'b1111)outy

else outy

end

end aign cout=((outy==4'b1111)&en)?1'b1:1'b0;endmodule（2）电路图：

（3）编译：

（4）引脚锁定：

（5）仿真报告：

（6）分析报告：

键3控制使能，键4控制清零，时钟clock0选择4Hz,按下键3，数码管8开始从0开始计数，一直到F，重新开始，继续循环从0开始，按下键4立即清零。

基于LPM宏模块的计数器设计

（1）电路图：

（2）编译：

（3）引脚锁定：

（4）仿真报告：

（5）分析报告：

键3控制使能，键4控制清零，时钟clock0选择4Hz,按下键3，数码管8开始从0开始计数，一直到F，重新开始，继续循环从0开始，按下键4立即清零。